24AA52T-I/MC【PDF 3/36 页】IC EEPROM 2KBIT 400KHZ 8DFN

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24AA52/24LCS52

TABLE 1-2:

AC SPECIFICATIONS

AC CHARACTERISTICS

V CC = +1.8V to +5.5V

Industrial (I): T A = -40°C to +85°C

Param.

No.

1

Symbol

F CLK

Characteristic

Clock frequency

Min

—

Typ

—

Max

400

Units

kHz

Conditions

2.2V ? V CC ? 5.5V

—

—

100

1.8V ? V CC ? 2.5V (24AA52)

2

3

T HIGH

T LOW

Clock high time

Clock low time

600

4000

1300

—

—

—

—

—

—

ns

ns

2.2V ? V CC ? 5.5V

1.8V ? V CC ? 2.5V (24AA52)

2.2V ? V CC ? 5.5V

4700

—

—

1.8V ? V CC ? 2.5V (24AA52)

4

T R

SDA and SCL rise time

—

—

300

ns

2.2V ? V CC ? 5.5V

(Note 1)

—

—

1000

1.8V ? V CC ? 2.5V (24AA52)

5

T F

SDA and SCL fall time

—

—

300

ns

(Note 1)

—

6

T HD : STA

Start condition hold time

600

—

—

ns

2.2V ? V CC ? 5.5V

4000

—

—

1.8V ? V CC ? 2.5V (24AA52)

7

T SU : STA

Start condition setup

600

—

—

ns

2.2V ? V CC ? 5.5V

time

4700

—

—

1.8V ? V CC ? 2.5V (24AA52)

8

T HD : DAT

Data input hold time

0

—

—

ns

(Note 2)

—

9

T SU : DAT

Data input setup time

100

—

—

ns

2.2V ? V CC ? 5.5V

250

—

—

1.8V ? V CC ? 2.5V (24AA52)

10

T SU : STO

Stop condition setup

600

—

—

ns

2.2V ? V CC ? 5.5V

time

4000

—

—

1.8V ? V CC ? 2.5V (24AA52)

11

12

T AA

T BUF

Output valid from clock

(Note 2)

Bus free time: Time the

—

—

1300

—

—

—

900

3500

—

ns

ns

2.2V ? V CC ? 5.5V

1.8V ? V CC ? 2.5V (24AA52)

2.2V ? V CC ? 5.5V

bus must be free before

4700

—

—

1.8V ? V CC ? 2.5V (24AA52)

a new transmission can

start

13

T OF

Output fall time from V IH 20 + 0.1 C B

minimum to V IL —

—

—

250

250

ns

2.2V ? V CC ? 5.5V

1.8V ? V CC ? 2.5V (24AA52)

maximum

14

T SP

Input filter spike

—

—

50

ns

(Note 1 and Note 3)

suppression

(SDA and SCL pins)

15

T WC

Write cycle time

—

—

5

ms

—

(byte or page)

16

—

Endurance

1M

—

—

cycles 25°C, V CC = 5.0V (Note 4)

Note 1: Not 100% tested. C B = total capacitance of one bus line in pF.

2: As a transmitter, the device must provide an internal minimum delay time to bridge the undefined region

(minimum 300 ns) of the falling edge of SCL to avoid unintended generation of Start or Stop conditions.

3: The combined T SP and V HYS specifications are due to new Schmitt Trigger inputs, which provide improved

noise spike suppression. This eliminates the need for a T I specification for standard operation.

4: This parameter is not tested but ensured by characterization. For endurance estimates in a specific

application, please consult the Total Endurance? Model which can be obtained from Microchip’s web site

at www.microchip.com.

? 1996-2011 Microchip Technology Inc.

DS21166K-page 3

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